上海 [2006-09-06]
Encounter時序系統應用於SMIC的90納米工藝
加州聖荷塞及中國上海，2006年9月6日 ?C Cadence 設計系統公司（NASDAQ:CDNS）與中芯國際積體電路製造有限公司（SMIC）（NYSE: SMI; SEHK: 0981.HK）今天宣佈，兩家公司已經聯合開發出低功耗數位元設計參考流程，支援SMIC先進的90納米工藝技術。該設計參考流程包含對Cadence® Encounter®時序系統的支援，以滿足設計師為電腦、消費電子、網路及無線產品市場開發積體電路越來越高的需求。
該設計參考流程結合了Cadence Encounter數位IC設計平臺和Cadence可製造性設計(DFM）技術，攻克了低功耗、複雜的層次設計、時序及信號集成（SI）簽收等納米設計的挑戰。該設計參考流程使用SMIC的90納米工藝技術進行開發，通過了樣品設計驗證。Cadence作為最早與SMIC合作的電子設計自動化公司之一，與SMIC一起推出了90納米Encounter低功耗系統級晶片設計參考流程。Cadence的新技術如Encounter時序系統已結合到該流程中，用於靜態時序分析（STA）簽收。
“與Cadence的合作幫助我們達成繼續推動中國和全球半導體市場發展的目標。”SMIC設計服務部副總裁歐陽雄說，“作為複雜低功耗及數位設計解決方案的領導者，Cadence提供了獨特的技術與專業知識，設計了這一參考設計流程。這一90納米SMIC低功耗參考設計流程，有Encounter時序系統及其它來自Cadence的尖端數位IC設計技術推動，加上SMIC的工藝技術，將確保我們的客戶獲得極高的品質和生產力，並提供了更快、更有效、風險更低的投片方式。”
這套“SMIC-Cadence設計參考流程”是一套完整的Encounter低功耗系統級晶片設計參考流程，其重點在於90納米系統級晶片（SoC）的高效能源利用。它對功耗問題的優化貫穿了所有必要的設計步驟，包括邏輯綜合、類比、測試設計、等價性檢驗、晶片虛擬原型、物理實現和完成簽收分析。Encounter低功耗流程是業界首個為現代系統級晶片節能需求而設計的完整的低功耗解決方案之一。設計、實現和驗證技術完整結合，讓設計師的工作效率大大提升。該設計參考流程採用了Cadence Encounter以連線為首要考量的連續收斂方法，讓設計師可以迅速得到可行的網表和虛擬原型，在設計週期的初期就可以分析及優化功耗、時序、SI和佈線。
此外，該流程為設計師提供了一個全面的平臺，強調快速、精確與自動時序、功耗與SI收斂，提高了Encounter的低功耗性能。它解決了層次模組分割、物理時序優化、3-D RC提取、電壓降、洩漏和動態功耗優化、信號幹擾故障和延遲分析等問題。該流程讓設計師可以用系統性的、可預測的方式進行設計和優化，得到最高品質的晶片。
“我們很高興與SMIC合作推出基於90納米工藝技術的參考設計流程。”Cadence產業聯盟業務發展部副總裁Mike McAweeney說。“我們與SMIC的合作讓我們的客戶在設計鏈上又有了一個重要的關聯，保證了從概念到投片的整個設計鏈的可製造性考量。它照顧了中國越來越多的製造廠和設計公司的需求，而他們一直依賴於Cadence的數位元元IC設計流程。”
SMIC-Cadence低功耗數位元元設計參考流程是創造次130納米的節能系統級晶片的起點。該流程融合了Cadence的多種獨創技術，包括優化功耗的設計流程、Encounter時序系統、Encounter RTL編譯器全局優化、Encounter低功耗系統級晶片參考設計流程、Cadence提取技術、搭配PowerMeter功能的VoltageStorm® 功耗分析以及CeltIC® 納米延時計算器（NDC），使用高度精確的有效電流源延時模型（ECSM），降低了低功耗消費應用電子產品的擴產時間。
可用性
SMIC與Cadence低功耗數位元設計參考流程套件將提供給SMIC客戶。SMIC客戶通過聯繫SMIC設計服務部索取該設計參考流程，聯繫方式為：design_services@smics.com.更多詳情可參考（資料表插入鍵連）。
關於SMIC
SMIC（NYSE:SMI; SEHK: 981）是全球領先的半導體製造企業，也是中國大陸最大、最先進的製造公司，提供了從0.35微米到90納米的積體電路（IC）製造服務和細分技術。SMIC總部位於中國上海，在上海有三家200毫米製造廠，還有一家位於天津，在北京還有一家300毫米製造廠，是中國大陸唯一的此類型企業。SMIC在美國、義大利和日本都有客戶服務和市場部，在香港設有代表處。欲瞭解更多詳情，敬請訪問：http://www.smics.com
關於Cadence
Cadence公司（Nasdaq股票代碼：CDNS）成就全球電子設計技術創新，並在創建當今積體電路和電子產品中發揮核心作用。我們的客戶採用Cadence的軟體、硬體、設計方法和服務，來設計和驗證用於消費電子產品、網路和通訊設備以及電腦系統中的尖端半導體器件、印刷電路板和電子系統。Cadence 2005年全球公司收入約13億美元，現擁有員工約5100名，公司總部位於美國加州聖荷塞市，公司在世界各地均設有銷售辦事處、設計中心和研究設施，以服務於全球電子產業。關於公司、產品及服務的更多資訊，敬請流覽公司網站：http://www.cadence.com.cn
就1995年私人有價證券訴訟改革法案作出的「安全港」提示聲明
本新聞發報之內容, 如“與Cadence的合作幫助我們達成繼續推動中國和全球半導體市場發展的目標”，可能載有前瞻性陳述之字眼。（除歷史資料外）或含有依據U.S. Securities Act 1933 (已修訂) 第27A條文及U.S. Securities Exchange Act 1934 (已修訂) 第21E條文所界定的「前瞻性陳述」。該等前瞻性陳述存在重大已知及未知風險、不確定性，以及其他可能導致中心實際業績、財政狀況或經營結果與前瞻性陳述所載資料存在重大差異的因素。有關該等風險、不確定性，以及其他因素之進一步資料已包括在中芯於二零零五年六月二十八日提交與美國證券交易所之20-F年報及其它中芯需不時提交與美國證券交易所或香港聯合交易所有限公司之檔內。
Cadence、Cadence標識、 CeltIC, Encounter和 VoltageStorm為Cadence設計系統公司注冊商標。所有其他版權為其各自擁有者資產。
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楊麗莉
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方露/常樂
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